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期刊论文 8

年份

2023 1

2021 2

2020 2

2012 1

2005 1

2001 1

关键词

DFS 1

FPGA 1

OSD 1

TMS320DM642 1

块匹配 1

帧频提升 1

扫描格式转换 1

混沌系统；霍普夫分岔；共存吸引子；偏置增强；FPGA实现；声音加密 1

现场可编程门阵列（FPGA）；泄漏功率；电源门控；晶体管级电路设计 1

疲劳检测 1

纠错算法；Bose–Chaudhuri–Hocquenghem（BCH）码；现场可编程门阵列（FPGA）；闪存 1

轻量级分组密码；现场可编程门阵列（FPGA）；低成本；PRINCE；嵌入式安全 1

轻量级密码；物联网（IoT）；嵌入式系统安全；加密；现场可编程门阵列；数据路径设计 1

运动补偿 1

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检索范围：

排序：展示方式：

扫描格式转换的自适应帧频提升算法及其FPGA实现

吴勇,张光烈,郑南宁,张霞

《中国工程科学》 2001年第3卷第4期页码 56-62

摘要：最后，通过建立对应于可变参数的因子査找表和采用现场可编程逻辑器件（FPGA)快速实现了扫描格式转换中的帧频提升算法，并应用在实际系统中，实验结果表明该算法十分有效。

关键词：扫描格式转换帧频提升块匹配运动补偿

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偏置增强自主五维混沌系统动态分析、FPGA实现及加密应用 Research Articles

Sifeu TAKOUGANG KINGNI1, Karthikeyan RAJAGOPAL2, Serdar ÇIÇEK3, Ashokkumar SRINIVASAN4, Anitha KARTHIKEYAN2

《信息与电子工程前沿（英文）》 2020年第21卷第6期页码 809-962 doi: 10.1631/FITEE.1900167

摘要：利用现场可编程门阵列（FPGA）实现该自主五维系统，并给出相图验证数值仿真结果。由FPGA实现的混沌吸引子及共存吸引子与数值仿真的混沌吸引子性质吻合较好。

关键词：混沌系统；霍普夫分岔；共存吸引子；偏置增强；FPGA实现；声音加密

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在现场可编程门阵列中用于降低泄漏功率的动态电源门控 Research Article

Hadi JAHANIRAD

《信息与电子工程前沿（英文）》 2023年第24卷第4期页码 582-598 doi: 10.1631/FITEE.2200084

摘要：现场可编程门阵列（FPGA）器件由于其低设计成本和可重构性，在电子系统中得到广泛应用。在手持电子系统等电池受限的应用中，低功耗FGPA的需求很大。我们提出一种基于静态随机存取存储器（SRAM）的FPGA高效架构，其中每个模块定义了两种模式（活动模式和休眠模式）。在休眠模式下，模块消耗超低泄漏功率。通过在FPGA-SPICE软件上实现北卡罗来纳州微电子中心（MCNC）基准电路，将所提出的低泄漏FPGA体系结构与最先进的体系结构进行比较。仿真结果表明，休眠模式下泄漏功耗降低约95%。

关键词：现场可编程门阵列（FPGA）；泄漏功率；电源门控；晶体管级电路设计

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一种应用于带有嵌入式存储器的FPGA的BCH纠错方案 Research Articles

刘洋1,李杰1,王瀚1,张德彪1,冯凯强1,李金强2

《信息与电子工程前沿（英文）》 2021年第22卷第8期页码 1127-1139 doi: 10.1631/FITEE.2000323

摘要：鉴于存储介质上的数据存在位翻转的可能，提出一种模块化的、高速并行的Bose–Chaudhuri–Hocquenghem（BCH）纠错方案，该方案结合了逻辑实现和查找表。所提方案适用于具有片上嵌入式存储器的现场可编程门阵列的数据纠错。详细阐述了系统各部分的优化方法，并分析了该方案在BCH码信息位长度为1024位、码长为1068位且可纠正4位错误情况下的实现过程。

关键词：纠错算法；Bose–Chaudhuri–Hocquenghem（BCH）码；现场可编程门阵列（FPGA）；闪存

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基于FPGA的资源节约型结构PRINCE的实现 Research Articles

李浪1,2,3,冯景亚1,2,刘波涛1,3,郭影1,3,李秋萍1,3

《信息与电子工程前沿（英文）》 2021年第22卷第11期页码 1505-1516 doi: 10.1631/FITEE.2000688

摘要：在当今普适计算时代，低资源设备已广泛部署在各个领域。PRINCE是一种专为低延迟设计的轻量级分组密码，适用于普适计算应用程序。本文通过共享和简化逻辑电路为PRINCE组件提出新的电路结构，以达到使用较少逻辑门获得相同效果的目标。基于组件新的电路结构和组件之间的最佳共享，提出3种新的PRINCE硬件架构，并在不同可编程门阵列设备上对3种硬件架构进行仿真和综合。基于Virtex-6平台的实验结果表明，与现有架构相比，展开、低成本和两周期架构的资源消耗分别减少73、119和380个可编程逻辑单元。低成本架构仅需137个可编程逻辑单元。展开架构需409个可编程逻辑单元，其吞吐量为5.34 Gb/s。据我们所知，对于PRINCE的硬件实现，所提低成本架构具有更低资源消耗，且所提展开架构具有更高吞吐量。因此，所提架构具有更高资源效率，适用于低资源、低延迟的应用程序。

关键词：轻量级分组密码；现场可编程门阵列（FPGA）；低成本；PRINCE；嵌入式安全

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基于TMS320DM642的疲劳检测系统硬件设计

耿磊,吴晓娟,彭彰

《中国工程科学》 2005年第7卷第11期页码 87-90

摘要：针对疲劳检测算法中大数据量、高速传输、复杂运算的实际需要，设计了以SAA7115 为视频采集AD，DSP器件TMS320DM642为核心处理器，SAA7105为视频输出DA，利用FPGA控制输出，以实现增强显示功能的实时视频处理系统

关键词： TMS320DM642 疲劳检测 DFS FPGA OSD

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Frequency-controlable sine signal based on PWM and its implementation on FPGA

Lianzhen HUANG, Jiangang LI, Dongjun ZHANG

《机械工程前沿（英文）》 2012年第7卷第3期页码 322-328 doi: 10.1007/s11465-012-0312-9

摘要：

A sine generation method that the different frequent sine signals can be generated by the different Pulse-Width Modulation (PWM) signals generated by Field-Programmable Gate Array (FPGA) through low-pass filter of fixed parameters was proposed. The method just takes a few FPGA resources and was proved feasible by the theory. The experiment results and theory analysis tally.

关键词： Pulse-Width Modulation (PWM) Field-Programmable Gate Array (FPGA) frequency controllable